MAX9316A 1:5差分(LV)PECL/(LV)ECL/HSTL时钟和数据驱动器

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1:5差分(LV)PECL/(LV)ECL/HSTL时钟、数据驱动器，用于时钟与数据分配

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MAX9316A是一种低扭曲、1:5差分驱动器，设计应用于时钟和数据分配。该器件允许在两路输入之间选择：一路差分输入和一路单端输入，所选中的输入再生5路差分输出。差分输入经过调整后，可以允许单端输入，只需将片上V_BB电源接到一个输入端作为参考电压即可。

MAX9316A低输出至输出扭曲(20ps)的特点，尤其适合于通过背板或电路板上的时钟和数据分配。在与差分HSTL和(LV)PECL信号接口时，这些器件工作在3.0V至5.5V的电源范围，能够实现在3.3V或5.0V标称电源的系统中，进行高性能的时钟或数据分配。与差分(LV)ECL接口时，这些器件工作在-3.0V至-5.5V的电源范围。

MAX9316A提供20引脚宽体SO封装。

关键特性 应用/使用

1.5GHz时保证400mV差分输出
可选择的单端或差分输入
130ps (最大)部件至部件扭曲(+25°C)
20ps输出至输出扭曲
365ps传输延迟
同步输出使能/禁止
用于单端输入时的片上基准电压
输入开路时，输入偏置至低
引脚兼容于MC100EL14

自动测试设备(ATE)
局端背板时钟分配
数据和时钟驱动器与缓冲器
DSLAM背板
低抖动数据中继器
精密时钟分配
无线基站

Key Specifications: High-Speed Interconnect (Differential Signaling)

Part Number

Features

Rx Signal Type

Tx Signal Type

Functions

Number of Rx

Number of Tx

Propagation Delay (max) (ps)

Supply Voltage (V)

Random Jitter (max) (ps RMS)

Deterministic Jitter (max) (ps pp)

Channel-to-Channel Skew (max) (ps)

Output Transition Time (max) (ps)

ESD Protection (±kV)

Package

Smallest Available Package (max w/pins) (mm²)

MAX9316A

•	Fail-Safe Inputs

•	Selectable Single Ended or Differential Input

•	Synchronous Output Enable

ECL
HSTL
LVECL
LVPECL
PECL

ECL
LVECL
LVPECL
PECL

•	Fan-Out Buffer

520

3.3
5

1.2

145

SOIC/20

138

See All High-Speed Interconnect (Differential Signaling) (131)

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参考文献： 19-2648; Rev. 0; 2002-11-22
本页最后一次更新: 2007-08-02

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