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时钟分配器
MAX9324
1至5 LVPECL/LVCMOS输出时钟和数据驱动器
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MAX9324是一种低扭曲、低抖动时钟和数据驱动器,将一路差分LVPECL分配到4路差分LVPECL输出和一路单端LVCMOS输出。当差分输入等于GND或开路时,所有输出处于缺省的逻辑低。该器件工作于3.0V至3.6V的电源电压,尤其适合于3.3V的系统,且仅消耗25mA的电源电流(最大)。
MAX9324具有150ps (最大)低器件-器件扭曲、15ps低输出-输出扭曲和1.7ps低RMS抖动等特性,尤其适合于通过背板或电路板上的时钟和数据分配。CLK_EN和SEOUT_Z控制各个输出的状态,CLK_EN变低使差分(Q_,Q_)输出差分低电平状态,SEOUT输出置为单端逻辑低状态。CLK_EN工作与CLK_输入同步。SEOUT_Z的高电平将SEOUT置为高阻态,SEOUT_Z异步于CLK (/CLK)输入。
MAX9324有节省空间的20引脚TSSOP封装和超小型的20引脚4mm x 4mm薄型QFN封装,工作于-40°C至+85°C的扩展级温度范围。
关键特性
应用/使用
15ps的差分输出至输出扭曲
1.7ps
RMS
加性随机抖动
150ps (最大)器件至器件扭曲
450ps的传输延迟
同步输出使能/禁止
单端监测输出
当CLK,/CLK开路或接地,输出为低
3.0V至3.6V的电源电压
-40°C至+85°C的工作温度范围
自动测试设备(ATE)
局端背板时钟分配
数据和时钟驱动器与缓冲器
DSLAM背板
低抖动数据中继器
精密时钟分配
无线基站
Key Specifications: High-Speed Interconnect (Differential Signaling)
Part Number
Features
Rx Signal Type
Tx Signal Type
Functions
Number of Rx
Number of Tx
Propagation Delay (max) (ps)
Supply Voltage (V)
MAX9324
Fail-Safe Inputs
Synchronous Output Enable
LVPECL
CMOS
LVPECL
LVTTL
Fan-Out Buffer
1
5
600
3.3
See All High-Speed Interconnect (Differential Signaling) (133)
图表
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参考文献: 19-2576; Rev. 0; 2002-10-31
本页最后一次更新: 2007-07-17
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